上拉电阻

百度一下上拉电阻与下拉电阻，一堆一堆的解释就出来了，不过，好像没有一个解释的通熟易懂的，可能是写解释的人水平太高了，说的话小白听不懂。

我来给你来点通熟易懂的解释吧。

上拉电阻与下拉电阻用在什么场合？

答：用在数字电路中，存在高低电平的场合。

上拉电阻与下拉电阻怎么接线？

上拉电阻：电阻一端接VCC，一端接逻辑电平接入引脚（如单片机引脚）

下拉电阻：电阻一端接GND，一端接逻辑电平接入引脚（如单片机引脚）

如上图，R13和R14，一端接到了3.3V,一端通过J17连接到单片机引脚，这两个电阻就是上拉电阻。

如上图，R18的一端连接到了GND,一端连接到了单片机的引脚（只不过是串了一个电阻后连接到了单片机引脚）。所以这个就是下拉电阻。

上拉电阻和下拉电阻有什么用？

1.提高驱动能力：

例如，用单片机输出高电平，但由于后续电路的影响，输出的高电平不高，就是达不到VCC，影响电路工作。所以要接上拉电阻。下拉电阻情况相反，让单片机引脚输出低电平，结果由于后续电路影响输出的低电平达不到GND，所以接个下拉电阻。

2.在单片机引脚电平不定的时候，让后面有一个稳定的电平：

例如上面接下拉电阻的情况下，在单片机刚上电的时候，电平是不定的，还有就是如果你连接的单片机在上电以后，单片机引脚是输入引脚而不是输出引脚，那这时候的单片机电平也是不定的，R18的作用就是如果前面的单片机引脚电平不定的话，强制让电平保持在低电平。

再这么解释一下吧，如果IE_DATA那个地方，不连接任何引脚，那么由于R18的下拉作用，IE_DATA就是低电平，所以三极管就不会导通。

不知道你清楚了没有？

1、上拉就是将不确定的信号通过一个电阻嵌位在高电平！“电阻同时起限流作用”！下拉同理！

2、上拉是对器件注入电流，下拉是输出电流

3、弱强只是上拉电阻的阻值不同，没有什么严格区分

4、对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。

上拉电阻作用

1、一般作单键触发使用时，如果IC本身没有内接电阻，为了使单键维持在不被触发的状态或是触发后回到原状态，必须在IC外部另接一电阻。

2、数字电路有三种状态：高电平、低电平、和高阻状态，有些应用场合不希望出现高阻状态，可以通过上拉电阻或下拉电阻的方式使处于稳定状态，具体视设计要求而定！

3、一般说的是I/O端口，有的可以设置，有的不可以设置，有的是内置，有的是需要外接，I/O端口的输出类似与一个三极管的C，当C接通过一个电阻和电源连接在一起的时候，该电阻成为上C拉电阻，也就是说，如果该端口正常时为高电平；C通过一个电阻和地连接在一起的时候，该电阻称为下拉电阻，使该端口平时为低电平，作用吗：比如：“当一个接有上拉电阻的端口设为输入状态时，他的常态就为高电平，用于检测低电平的输入”。

4、上拉电阻是用来解决总线驱动能力不足时提供电流的。一般说法是拉电流，下拉电阻是用来吸收电流的，也就是我们通常所说的灌电流

5、接电阻就是为了防止输入端悬空

6、减弱外部电流对芯片产生的干扰

7、保护cmos内的保护二极管，一般电流不大于10mA

8、通过上拉或下拉来增加或减小驱动电流

9、改变电平的电位，常用在TTL-CMOS匹配

10、在引脚悬空时有确定的状态

11、增加高电平输出时的驱动能力。

12、为OC门提供电流。

上拉电阻在电路中的主要作用就是对电流起到限流作用，在一些设计当中经常会用到上拉与下拉电阻，但电源的设计者们往往对这两种电阻了解的不多，正因如此，在电路出现因为上拉与下拉电阻而导致的问题时，设计者们却会找不到相应的解决方法。在本篇文章当中，小编将为大家分享关于上拉电阻的一些基础知识与经验，希望能为大家有所帮助。

上拉电阻经验总结

1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平(一般为3.5V)，这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。

2、OC门电路必须加上拉电阻，才能使用。

3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。

4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。

5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限增强抗干扰能力。

6、提高总线的抗电磁干扰能力。管脚悬空就比较容易接受外界的电磁干扰。

7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。

上拉电阻阻值的选择原则

从灌电流的能力与节约能源的考虑出发，应具备电阻大，电流小的特点。从节约功耗及芯片的灌电流能力考虑应当足够大;电阻大，电流小。从确保足够的驱动电流考虑应当足够小;电阻小，电流大。对于高速电路，过大的上拉电阻可能边沿变平缓。

在10K到1K之间，适用于以上三点。对下拉电阻也有类似道理。对上拉电阻和下拉电阻的选择应结合开关管特性和下级电路的输入特性进行设定，主要需要考虑以下几个因素：

1、驱动能力与功耗的平衡。以上拉电阻为例，一般地说，上拉电阻越小，驱动能力越强，但功耗越大，设计是应注意两者之间的均衡。

2、下级电路的驱动需求。同样以上拉电阻为例，当输出高电平时，开关管断开，上拉电阻应适当选择以能够向下级电路提供足够的电流。

3、高低电平的设定。不同电路的高低电平的门槛电平会有不同，电阻应适当设定以确保能输出正确的电平。以上拉电阻为例，当输出低电平时，开关管导通，上拉电阻和开关管导通电阻分压值应确保在零电平门槛之下。

4、频率特性。以上拉电阻为例，上拉电阻和开关管漏源级之间的电容和下级电路之间的输入电容会形成RC延迟，电阻越大，延迟越大。上拉电阻的设定应考虑电路在这方面的需求。

本篇文章对上拉电阻的相关经验与选择原则进行了介绍，在这其中，对上拉电阻的选择是本篇文章的重点内容，希望大家能够利用本篇文章当中的知识点运用到自己的设计中去，丰富自己的知识储备。