本文主要使用时域分析工具对 DDR3设计进行量化分析，介绍了影响信号完整性 的主要因素对 DDR3进行时序分析，通过分析结果进行改进及优化设计。 1 概述 当今计算机系统 DDR3存储器技术已得到广泛应用，数据传输率一再被提升，现 已高达 1866Mbps。在这种高速总线条件下，要保证数据传输质量的可靠性和满 足并行总线的时序要求，对设计实现提出了极大的挑战。 本文主要使用了 Cadence公司的时域分析工具对 DDR3设计进行量化分析，介绍 了影响信号完整性的主要因素对 DDR3进行时序分析，通过分析结果进行改进及 优化设计，提升信号质量使其可靠性和安全性大大提高。 2 DDR3介绍 DDR3内存与 DDR2内存相似包含控制器和存储器 2个部分，都采用源同步时序， 即选通信号 (时钟 )不是独立的时钟源发送， 而是由驱动芯片发送。 它比 DR2有更 高的数据传输率，最高可达 1866Mb
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