设计了一种基于LVDS的高速数据交换引擎IP核,并详细阐述了在FPGA上的实现原理和关键设计.该IP核能广泛适用于低速、高速FPGA中,测试结果表明,IP核的逻辑功能正确,可适应从spartan3A器件上时钟频率150MHz,300Mb/s数据传输速率(1位模式,4位模式下达到1.2Gb/s),到Virtex6器件上时钟频率500MHz,1Gb/s数据传输速率(1位模式,4位模式下达到4Gb/s).
在当今的工业计算机应用中，产品信息的通讯、交换和共享存在严重问题，国际标准化组织ＩＳＯ为了解决这个问题，开发了国际产品数据交换标准ＳＴＥＰ。本文简述了ＳＴＥＰ的内容及其在建筑业中的发展，并对建筑物描述的应用协议ＡＰ２２５作了详细的介绍
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